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题名/责任者:

用于逻辑综合的VHDL/(美) Andrew Rushton著 刘雷波, 陈英杰译

出版发行项:

北京:北京航空航天大学出版社,2014

ISBN及定价:

978-7-5124-1366-5/CNY89.00

载体形态项:

453页:图;24cm

统一题名:

VHDL for logic synthesis

丛编项:

国外数字系统设计经典教材系列

个人责任者:

拉什顿 (Rushton, Andrew) 著

个人次要责任者:

刘雷波 译

个人次要责任者:

陈英杰 译

学科主题:

VHDL语言-程序设计

中图法分类号:

TP312VH

版本附注:

据原书第3版译出

责任者附注:

责任者规范汉译姓: 拉什顿。

书目附注:

有书目

提要文摘附注:

本书全面介绍了可综合的VHDL语法条款。但是，考虑到测试工作的重要性，本书也介绍了一部分最为实用的编写测试平台有关的VHDL语法。

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