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题名/责任者:

Verilog HDL数字系统设计及实践/刘睿强, 童贞理, 尹洪剑编著

出版发行项:

北京:电子工业出版社,2011

ISBN及定价:

978-7-121-12021-3/CNY29.00

载体形态项:

213页:图;26cm

丛编项:

新编电气与电子信息类规划教材

个人责任者:

刘睿强 编著

个人责任者:

童贞理 编著

个人责任者:

尹洪剑 编著

学科主题:

VHDL语言-程序设计-教材

中图法分类号:

TP312VH

书目附注:

有书目

提要文摘附注:

本书介绍Verilog HDL硬件描述语言及电路设计方法，共11章，主要内容包括：Verilog层次化设计、Verilog基本语法、Verilog行为描述、组合逻辑建模、时序逻辑建模、为级仿真模型建模、各层次Verilog描述形式与电路建模、任务和函数、编译预处理、Verilog设计与综合中的陷阱、异步设计与同步设计的时序分析。本书配套实验，提供电子课件和习题参考答案。

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