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题名/责任者:

Verilog HDL高级数字设计/(美) Michael D.Ciletti著 张雅绮, 李锵等译

出版发行项:

北京:电子工业出版社,2005

ISBN及定价:

7-5053-9917-9/CNY65.00

载体形态项:

710页:图;26cm

并列正题名:

Advanced dgital design with the verilog HDL

丛编项:

国外电子与通信教材系列

个人责任者:

Ciletti Michael D. 著

个人次要责任者:

张雅绮 译

个人次要责任者:

李锵 译

学科主题:

硬件描述语言,VHDL-程序设计-教材

中图法分类号:

TP312HD

责任者附注:

责任者规范汉译姓：西里提

提要文摘附注:

本书通过大量完整的实例讲解了使用Verilog HDL进行超大规模集成电路设计的结构化建模方法、关键步骤和设计验证方法等实用内容。全书共分11章，涵盖了建模、结构平衡、功能验证、故障模拟和逻辑综合等关键问题，还有后综合设计确认、定时分析及可测性设计等内容。

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