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题名/责任者:

Verilog HDL数字系统设计及仿真/于斌编著

出版发行项:

北京:电子工业出版社,2014

ISBN及定价:

978-7-121-22284-9/CNY65.00 (含光盘)

ISBN及定价:

978-7-89432-814-4 光盘

载体形态项:

448页:图;26cm+光盘1片

丛编项:

工程设计与分析系列

个人责任者:

于斌 编著

学科主题:

VHDL语言-仿真程序-程序设计

中图法分类号:

TP312VH

载体形态附注:

附光盘：ISBN 978-7-89432-814-4

提要文摘附注:

本书着重从设计角度入手，每章都力求让读者掌握一种设计方法，能够利用本章知识进行完整的设计，从模块的角度逐步完成对Verilog HDL 语法的学习，从而在整体上掌握Verilog HDL 语法。

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